10GBASE-R PHY Intel® FPGA IP

10GBASE-BPASE-R PHY Intel® FPGA Intellectual Property (IP) core 可直接連接任何 XFP 或 SFP+ 光纖模組，或搭載 XFI 與 SFI 介面的任何外部裝置。

PHY IP core 能夠針對 10G 乙太網路 MAC 搭配 Intel FPGA IP 使用，或透過執行 156.25 Mbps 的標準 XGMII 介面，搭配客戶開發的乙太網路 MAC 使用。

這種 PHY IP core 屬於 Intel® FPGA 收發器功能的一部分。

功能特色

PHY 由 10GBASE-R 實體編碼次層 (PCS)、10.3125-Gbps 實體媒體附接 (PMA) 和 PHY 管理功能構成。
搭配 10GbE MAC 的直接介面，可用於完整的單晶片解決方案。
PHY 已整合至 Intel® Arria® 10、Stratix® V 和 Arria® V GZ FPGA 中的硬性矽晶片中，搭載 10.3125 Gbps 序列收發器。軟性 10GBASE-R PCS 也可用於 Stratix® IV GT 和 Arria® V（GT 和 ST）FPGA。
適用於晶片到晶片、晶片到光纖模組、晶片到 PHY 裝置和背板應用程式的直接 1125 Gbps 序列連接。
動態部分可重新配置 I/O (DPRIO) 支援序列收發器，可在運作期間適應系統中的各種 10GBASE-R 通道特性和裝置。
執行乙太網路標準 10GBASE-R PHY 功能：64b/66b 編碼或解碼、拌碼/解拌碼、用於時脈頻率補償的對應接收器速率、66b/16b 工具箱以及與 10.3125 Gbps 線路之間的資料序列化或還原序列化。
接收器連結故障狀態偵測。
從傳輸器的本地序列迴路到測試用的序列收發器。
用於高精準度和準確時間戳的 IEEE 1588 v2 選項。
高效能內部系統介面
Intel® FPGA Avalon® Streaming (Avalon-ST) single data rate (SDR) XGMII，資料傳輸速率為 72 位元 156.25 Mbps
Intel® FPGA Avalon® Memory-Mapped (Avalon-MM) 從屬管理為 32 位元
符合標準的 IEEE 802.3 10GbE，條款 46、49 和 51。
通過新 University of New Hampshire Interoperability Lab (UNH-IOL) 10 Gbps 乙太網路 MAC 和 PCS 驗證測試。

基本功能
首次發布年度 IP	2015 年
支援第一版 Intel Quartus Prime 軟體	16.1
訂購代碼	IP-10GMRPHY：Intel Arria 10 IP-10GBASERPCS：Cyclone V 系列 IP-10GMRPHY：Intel Cyclone10 IP-10GETHMAC：10-Gbps 乙太網路 MAC MegaCore
狀態	生產
可交付成果
客戶可交付成果包括下列項目︰設計檔案（加密原始程式碼或合成後網表） ModelSim 的模擬模型*：Intel FPGA 版計時與（或）佈局限制具有修訂控制的文件讀我檔案	Y
以 IP 提供的任何其他客戶可交付成果
可讓最終使用者設定 IP 的參數化 GUI	Y
已啟用 IP 核心以支援 Intel FPGA IP 評估模式	Y
Source language	Verilog
測試平台語言
提供的軟體驅動程式	N
驅動程式作業系統支援
實作
使用者介面	XGGMII 單一資料速率／GMII／16 位元 GMII（資料路徑）、Avalon-MM（管理）
IP-XACT 中繼資料	N
驗證
支援的模擬器	Mentor Graphics、Synopsys、Cadence*
經過驗證的硬體	Intel Stratix 10、Intel Arria 10
已執行業界標準合規性測試	Y
如果是，是哪種測試？	46、49 和 51
如果是，在哪種 Intel FPGA 裝置上？
如果是，執行日期
如果否，是否已規劃？	N
互通性
IP 已經過互通性測試	N
如果是，在哪個 Intel FPGA 裝置上
提供互通性報告	N

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