Serial Lite IV Intel® FPGA IP 核心
Serial Lite IV Intel® FPGA Intellectual Property (IP) core 適用於晶片對晶片、機板對機板和背板應用的高頻寬資料通訊。
Serial Lite IV Intel® FPGA IP 核心
Serial Lite IV IP 核心包含媒體存取控制(MAC)、實體編碼次層(PCS)與實體媒體附接(PMA)區塊。這個 IP 支援每通道高達 58 Gbps 的資料傳輸,上限為單一連結中 12 條 Intel® Agilex™ F-tile General-Purpose Transceivers (FGT) 的 PAM4 通道,或是每通道 28 Gbps 之上限為 16 條 FGT 的不歸零(NRZ)通道,以及每通道 58 Gbps 之上限為 4 條 FHT 的 NRZ 通道。此通訊協定提供高頻寬、低負荷訊框,低 I/O 數量,並同時支援通道數量與速度的高可擴充性。透過 E-Tile 收發器和 F-Tile 收發器的乙太網路 PCS 模式的支援各種資料傳輸率,您可輕鬆重新配置 IP。
此 IP 支援兩種傳輸模式:
- 基本模式:這是一種純串流模式,在這種模式下傳送資料不會有封包起始、空循環及封包結尾,以增加頻寬。IP 會將第一個有效資料作為突發的起始。
- 完整模式:這是資料傳輸的封包模式。突發和同步循環會作為定界符在封包的起始與結尾傳送。
功能特色
功能特色 | 描述 |
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資料傳輸 |
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PCS |
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錯誤偵測與處理 |
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介面 |
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其他資源
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