QDR II SRAM 控制器 Intel® FPGA IP 功能

QDR II SRAM控制器Intel FPGA IP為QDR II SRAM和QDR II+ SRAM模組提供了一個易於使用的介面。QDR II SRAM控制器確保放置和時序符合QDR II規範。QDR II SRAM控制器的本地介面與Intel FPGA Avalon®記憶體映射介面相容，可輕鬆整合到Intel Qsys IP。

閱讀《QDRII SRAM控制器MegaCore功能使用者指南》。

QDR II SRAM 控制器 Intel® FPGA IP 功能

QDR II SRAM控制器Intel FPGA IP針對Stratix®系列和Cyclone® IV FPGA進行了優化。這些器件中的高級功能使你能夠直接與QDR II SRAM器件連接。

IP Toolbench生成的示例設計產生實體了鎖相環（PLL）、可選的延遲鎖相環（僅適用於Stratix II FPGA）、示例驅動器和你的QDR II SRAM控制器的自訂變化。該範例設計是一個全功能的範例設計，可以進行類比、合成，並在硬體中使用。示例驅動是一個自測試模組，它向控制器發出讀寫命令，並檢查讀取的資料以產生通過/失敗和測試完成信號。你可以用你自己的定制邏輯替換示例設計中的QDR II SRAM控制器的加密控制邏輯，這樣你就可以用你自己的控制邏輯來使用Intel FPGA的明文再同步和流水線邏輯以及資料路徑。

該 IP 包含在 1IP基礎套件1中，該套件與 Intel® Quartus® Prime 標準版和專業版軟體捆綁在一起。

功能特色

  • 支持 QDR II 和 QDR II+ SRAM
  • 支援兩個和四個記憶體類型的突發事件
  • 支援 8 位元、18 位元和 36 位元 QDR II SRAM 介面
  • 彈性與強化的設計
  • 在本機端支援 2 倍和 4 倍的資料寬度（4 倍僅適用於 4 人連發）
  • 連續讀寫的自動串聯（僅在狹窄的本機匯流排寬度模式下）。
  • 用於 Intel 支援的 VHDL 和 Verilog HDL 模擬器的智慧財產權（IP）功能模擬模型
  • 易於使用的 IP Toolbench 介面和實例設計
  • 支援Intel FPGA IP評估模式

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