關鍵元件

產品集合
Stratix® V E FPGA
狀態
Launched
推出日期
2010
光刻
28 nm

相關資源

邏輯元素 (LE)
840000
適應性邏輯模組 (ALM)
317000
適應性邏輯模組 (ALM) 暫存器
1268000
結構和 I/O 相鎖環路 (PLL)
28
最大嵌入式記憶體
61.67 Mb
數位訊號處理 (DSP) 區塊
352
數位訊號處理 (DSP) 格式
Multiply and Accumulate, Variable Precision, Fixed Point (hard IP)
硬記憶體控制器
外部記憶體介面(EMIF)
DDR, DDR2, DDR3, QDR II, QDR II+, RLDRAM II, RLDRAM 3

I/O 規格

使用者 I/O 數量上限
840
I/O 標準支援
3.0 V LVTTL, 1.2 V to 3.0 V LVCMOS, SSTL, HSTL, HSUL, Differential SSTL, Differential HSTL, Differential HSUL, LVDS, Mini-LVDS, RSDS, LVPECL, BLVDS
最大 LVDS 對
420

封裝規格

封裝選項
F1517, F1932