關鍵元件

狀態
Launched
推出日期
2017
光刻
20 nm

相關資源

邏輯元素 (LE)
150000
適應性邏輯模組 (ALM)
54770
適應性邏輯模組 (ALM) 暫存器
219080
結構和 I/O 相鎖環路 (PLL)
10
最大嵌入式記憶體
10.652 Mb
數位訊號處理 (DSP) 區塊
156
數位訊號處理 (DSP) 格式
Multiply, Multiply and Accumulate, Variable Precision, Fixed Point (hard IP), Floating Point (hard IP)
硬記憶體控制器
外部記憶體介面(EMIF)
DDR3, DDR3L, LPDDR3

I/O 規格

使用者 I/O 數量上限
284
I/O 標準支援
3.0 V LVTTL, 1.2 V to 3.0 V LVCMOS, SSTL, POD, HSTL, HSUL, Differential SSTL, Differential POD, Differential HSTL, Differential HSUL, LVDS, Mini-LVDS, RSDS, LVPECL
最大 LVDS 對
118
不歸零(NRZ)收發器上限
12
不歸零(NRZ)資料速率上限
12.5 Gbps
收發器協定硬 IP
PCIe Gen2

進階技術

FPGA 位元流安全性

封裝規格

封裝選項
U484, F672, F780