在 Intel® Stratix® 10 裝置中,頻率輸入 muxing 的頻率控制Intel® FPGA IP沒有上限。
與先前Intel® FPGA裝置中的頻率控制區塊 (ALTCLKCRTL) IP 不同,當 IP 用於頻率輸入粘合時,頻率控制Intel® FPGA IP則由邏輯元素組成,而不需頻率壿斷或輸出分割選項。因此,最大數量取決於裝置使用率和設計複雜度。
環境
Intel® Quartus® II 訂閱版
BUILT IN - ARTICLE INTRO SECOND COMPONENT
描述