重大問題
此問題影響到 V 和 Cyclone V HPS 介面Arria。
NC-Sim 模擬器需要每個檔案包含一個時間 擴充指令。部分Altera Verilog 或 System Verilog 檔案 因為 HPS 模擬可能缺少所需的時間範圍。
此問題的解決方法是將下列內容新增到任何 遺失時間範圍指令的檔案:
timescale 1 ps / 1 ps
此問題將在未來的版本中解決。
重大問題
此問題影響到 V 和 Cyclone V HPS 介面Arria。
NC-Sim 模擬器需要每個檔案包含一個時間 擴充指令。部分Altera Verilog 或 System Verilog 檔案 因為 HPS 模擬可能缺少所需的時間範圍。
此問題的解決方法是將下列內容新增到任何 遺失時間範圍指令的檔案:
timescale 1 ps / 1 ps
此問題將在未來的版本中解決。
1
所有在本網站登出的文章及相關內容的使用均受到 Intel.com 使用條款的約束。
這個頁面的內容綜合了英文原始內容的人工翻譯譯文與機器翻譯譯文。本內容是基於一般資訊目的,方便您參考而提供,不應視同完整或準確的內容。如果這個頁面的英文版與譯文之間發生任何牴觸,將受英文版規範及管轄。 查看這個頁面的英文版。