硬核處理器系統 Intel® Stratix® 10 FPGA IP 的「FPGA介面」選項卡上 HPS 啟動源部分中的 HPS SSBL 位置下拉清單是 18.1 版的新增內容。其目的是讓使用者選擇 HPS 第一級引導載入程式應從何處載入第二階段引導載入程式。但是,更改此下拉清單不會影響 HPS 行為,因為資訊僅從 Intel® Quartus®傳遞到安全裝置管理員固件。U-Boot 未觀察到該設置,因此似乎沒有任何效果。
若要更改 HPS SSBL 位置,需要更改 U-Boot 原始程式碼。該設置在檔 arch/arm/mach-socfpga/spl_s10.c 中的函數 spl_boot_device() 中配置。有關如何將 HPS SSBL 位置更改為 SDM QSPI 快閃記憶體的示例,請使用此處提供的說明: Stratix10SoCSingleQspiFlashBoot
從 Intel® Quartus® Prime Pro/Standard Edition 軟體版本 20.1 及其版本 U-Boot-socfpga 開始,完全支援此功能。