文章 ID: 000077425 內容類型: 疑難排解 最近查看日期: 2017 年 01 月 05 日

為什麼對 PIPE 通道極性倒置的 Stratix 10 Native PHY IP Core 無法立即生效?

環境

BUILT IN - ARTICLE INTRO SECOND COMPONENT
描述

當pipe_rx_polarity被宣稱為倒轉通道極性時,倒轉資料會出現在匯流排的rx_parallel_data上,最多需要 24 個 PCLK,而非第 1/2 代最多 20 個 PCLK。

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Intel® Stratix® 10 FPGA 與 SoC FPGA

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