文章 ID: 000079943 內容類型: 疑難排解 最近查看日期: 2013 年 06 月 19 日

為什麼偏移0x10 mdio_addr1訊號具有三重速度乙太網路 IP 核心的「0」值?

環境

BUILT IN - ARTICLE INTRO SECOND COMPONENT
描述 三重速度乙太網路 MegaCore® 功能使用指南指出,HW 重設mdio_addr1值為「1」。只有在開啟 MDIO 選項時才適用。如果在三重速度乙太網路 IP 即時中關閉 MDIO 選項,mdio_addr1的硬體重設值為 '0'。

相關產品

本文章適用於 28 產品

Cyclone® V GT FPGA
Cyclone® III FPGA
Stratix® V GX FPGA
Cyclone® IV GX FPGA
Cyclone® V GX FPGA
Cyclone® II FPGA
Stratix® V GS FPGA
Arria® V GZ FPGA
Stratix® II GX FPGA
Stratix® II FPGA
Arria® V GX FPGA
Stratix® V GT FPGA
Arria® V GT FPGA
Stratix® III FPGA
Stratix® IV GX FPGA
Arria® II GX FPGA
Arria® II GZ FPGA
Stratix® IV GT FPGA
Cyclone® V E FPGA
Stratix® V E FPGA
Arria® GX FPGA
Cyclone® V SX SoC FPGA
Cyclone® V ST SoC FPGA
Cyclone® V SE SoC FPGA
Cyclone® IV E FPGA
Arria® V ST SoC FPGA
Cyclone® III LS FPGA
Stratix® IV E FPGA

這個頁面的內容綜合了英文原始內容的人工翻譯譯文與機器翻譯譯文。本內容是基於一般資訊目的,方便您參考而提供,不應視同完整或準確的內容。如果這個頁面的英文版與譯文之間發生任何牴觸,將受英文版規範及管轄。 查看這個頁面的英文版。