文章 ID: 000080038 內容類型: 錯誤訊息 最近查看日期: 2013 年 09 月 17 日

警告 (11106):共用 VREF 用作 GPIO <pin action="" fmax="" name="" performance.="" reduces="" this=""></pin>

環境

BUILT IN - ARTICLE INTRO SECOND COMPONENT
描述 VREF 針腳比支援雙用途 VREF 針腳的裝置中的其他針腳具有較高的針腳電容性。避免將 VREF 針腳用作匯流排或頻率功能的 I/O 針腳,因為較高的電容率會減緩邊緣速率並影響 I/O 計時。 
解決方法

 

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本文章適用於 5 產品

Arria® V GT FPGA
Arria® V GX FPGA
Arria® V SX SoC FPGA
Arria® V ST SoC FPGA
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