文章 ID: 000080366 內容類型: 疑難排解 最近查看日期: 2021 年 03 月 16 日

為什麼在啟用 RS-FEC 時,低延遲 100G 乙太網路Intel® Stratix® 10 FPGA IP 核心無法使用 Cadence* NCSim 和 Xcelium 進行模擬?

環境

  • Intel® Quartus® Prime Pro Edition 軟體
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    重大問題

    描述

    由於 RS-FEC 模式下低延遲 100G 乙太網路Intel® Stratix® 10 FPGA IP 核心的問題,Cadence* NCSim 和 Xcelium 的模擬都將失敗。

    將會看到類似下列錯誤:

    ncsim:*F,NOSNAP:程式庫中不存在「basic_avl_tb_top」快照。

    解決方法

    若要解決這個問題,請使用 Synopsys* VCSMX 或停用 RS-FEC。

    此問題不會排定在 Intel® Quartus® Prime 軟體的未來版本中修復。

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    Intel® Stratix® 10 FPGA 與 SoC FPGA

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