文章 ID: 000080827 內容類型: 疑難排解 最近查看日期: 2019 年 01 月 28 日

為什麼 PCI* Express IP 動態產生的設計範例的 Avalon®MM Intel® Stratix® 10 硬 IP，在 10 ES1 和 ES2 裝置上Intel® Stratix®故障時間？

環境

  • Intel® Quartus® Prime Pro Edition 軟體
  • 適用於 PCI Express* 的 Avalon-MM Intel® Stratix® 10 硬 IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    重大問題

    描述

    由於 Intel® Quartus® Prime Pro Ediiton 軟體版本 18.0 和 18.1 的問題，適用于 PCI Express IP 動態產生的設計範例的 Avalon®-MM Intel® Stratix® 10 硬 IP 無法進行靜態計時分析。

    解決方法

    此問題已從 Intel® Quartus® Prime Pro Edition 軟體版本 18.1.1 開始修復。

    相關產品

    本文章適用於 1 產品

    Intel® Stratix® 10 FPGA 與 SoC FPGA

    需要更多協助嗎？

    聯絡支援部門

    免責聲明

    1

    所有在本網站登出的文章及相關內容的使用均受到 Intel.com 使用條款的約束。

    這個頁面的內容綜合了英文原始內容的人工翻譯譯文與機器翻譯譯文。本內容是基於一般資訊目的，方便您參考而提供，不應視同完整或準確的內容。如果這個頁面的英文版與譯文之間發生任何牴觸，將受英文版規範及管轄。 查看這個頁面的英文版。