文章 ID: 000080932 內容類型: 疑難排解 最近查看日期: 2011 年 09 月 23 日

Stratix IV SERDES_RX的固定時序模擬

環境

  • Intel® Quartus® II 訂閱版
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    重大問題

    描述

    Stratix IV SERDES_RX的時間模擬錯誤已修復， 因此，SERDES_RX的計時模擬無法擷取 資料位正確。此問題不會影響矽晶片行為。

    解決方法

    沒有解決方法。

    相關產品

    本文章適用於 1 產品

    Stratix® IV FPGA

    需要更多協助嗎？

    聯絡支援部門

    免責聲明

    1

    所有在本網站登出的文章及相關內容的使用均受到 Intel.com 使用條款的約束。

    這個頁面的內容綜合了英文原始內容的人工翻譯譯文與機器翻譯譯文。本內容是基於一般資訊目的，方便您參考而提供，不應視同完整或準確的內容。如果這個頁面的英文版與譯文之間發生任何牴觸，將受英文版規範及管轄。 查看這個頁面的英文版。