由於PCI Express* 版本18.1的 Stratix® 10 Avalon -ST 和單根 I/O 虛擬化 (SR-IOV) 介面存在問題,您在Windows* 操作系統中生成設計範例時可能會觀察到此錯誤。
錯誤:add_fileset_file:沒有這樣的檔 <Quartus_Installation_Directory>/0002_pcie_s10_hip_ast_0_gen/ip/pcie_example_design/pcie_example_design_DUT/altera_xcvr_fpll_s10_htile_181/sim/docs/pcie_example_design_DUT_altera_xcvr_fpll_s10_htile_181_rrbjwya_parameters.csv/pcie_example_design_DUT_altera_xcvr_fpll_s10_htile_181_rrbjwya_parameters.csv
要變通解決此問題,請在Linux作業系統中生成範例設計。