由於在 Stratix V ES 裝置中配置後 JTAG 埠存取限制,您嘗試使用 SignalTap™ II Logic Analyzer 執行晶片上除錯時,可能會看到此錯誤。
此限制已固定在 Stratix V 生產裝置中。請參閱 Stratix V ES 裝置 (PDF) 的 Errata 表與準則。
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