文章 ID: 000094923 內容類型: 錯誤訊息 最近查看日期: 2023 年 05 月 19 日

為什麼 Intel® Stratix®10 低延遲乙太網路 10G MAC Intel® FPGA IP範例設計模擬失敗?

環境

  • Intel® Quartus® Prime Pro Edition 軟體
  • 低延遲乙太網路 10G MAC Intel® FPGA IP
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    描述

    由於 Intel® Quartus® Prime Pro Edition Software 版本 23.1 或更早版本的問題,使用 10M/100M/1G/2.5G/5G/10G(USXGMII)預設產生的設計範例時,模擬中會出現以下錯誤。


    # ** 錯誤:../models/altera_eth_top.sv(128):模組「altera_eth_top_auto_tiles」並未定義。

    解決方法

    這個問題沒有解決方法。
    此問題排定在 Intel® Quartus® Prime 軟體的未來版本中修復。

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    本文章適用於 1 產品

    Intel® Stratix® 10 FPGA 與 SoC FPGA

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