VHDL:1x64 Shift Register

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此範例說明 VHDL 中單位寬 64 位的輪班收銀機。合成工具能夠偵測輪班暫存器的群組,並自動推斷altshift_taps兆功能。此實作可能會在裝置區塊記憶體資源中執行,視目標裝置架構而定。

圖 1。1x64 Shift 收件機頂層圖表。

下載此範例中使用的檔案:

此設計之使用受 Intel® 設計範例授權協定的條款與細則管轄,並受其約束。

表 1 列出 1x64 班次收銀機設計的埠。

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