外部記憶體介面 IP 支援中心
外部記憶體介面 (EMIF) 支援頁面提供 Intel FPGAs從頭到尾的設計流程。
1. 設備選擇
如何選擇設備?
有兩個工具可説明您根據記憶體需求選擇Intel® FPGA:
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EMIF器件選擇器 |
EMIF 規格估算器 |
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特徵 |
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裝置支援 |
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資源 |
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EMIF 工具 |
下載適用于 Intel Agilex® 7、Intel® Stratix® 10 或 Intel® Arria 10 裝置的 EMIF 裝置選擇器 |
如何選擇外部記憶體智慧財產權 (IP)?
若要瞭解可用的各種記憶體智慧財產 (IP),請參閱以下線上訓練課程:
訓練課程 |
描述 |
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本課程涵蓋可用的不同外部記憶體介面選項,以及 Intel Stratix 10 和 Intel Arria 10 FPGAs的架構和硬記憶體控制器功能。 |
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本課程涵蓋將高頻寬記憶體集成到 Intel Stratix 10 MX FPGA 設備中的優勢、強化 HBM 控制器的功能和選項,以及如何生成 HBM2 IP。 |
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本課程涵蓋強化型 HBM 控制器的特性和選項,以及控制器和使用者邏輯之間的 Arm* AMBA 4 AXI 介面。 |
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本課程涵蓋硬核處理器子系統 (HPS) SDRAM 和 AMBA AXI 橋接架構的功能。 |
2. 使用者指南和文檔
Intel Agilex® 7 裝置 | Intel® Stratix® 10 台裝置 Intel® Arria® | 10 台裝置 | Intel® Cylcone® 10 裝置 | 其他使用者指南 |
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3. EMIF IP 生成
在哪裡可以找到有關 EMIF IP 的資訊?
有關外部記憶體介面 (EMIF) 智慧財產 (IP) 的資訊,請參閱以下外部記憶體介面 IP 使用者指南:
- 請參閱「使用者指南」部分
如何生成 EMIF IP?
有關外部記憶體介面 (EMIF) 智慧財產 (IP) 參數的詳細資訊,請參閱以下 EMIF IP 使用者指南中的以下特定于協定的部分:
如何執行功能模擬?
有關模擬外部儲存體介面 (EMIF) 智慧財產 (IP) 的詳細資訊,請參閱 EMIF IP 使用者指南中的以下部分:
Intel Agilex® 7 FPGA EMIF IP – 模擬記憶體 IP - Intel Stratix 10 模擬記憶體 IP
- Intel Stratix 10 MX 模擬 HBM2 IP
- Intel Arria 10 模擬記憶體 IP
- Intel Cyclone 10 模擬記憶體 IP
有關如何生成EMIF模擬設計示例以及如何使用ModelSim*-Intel FPGA模擬軟體運行模擬的說明,請參閱EMIF IP設計示例使用者指南中的以下部分:
- Intel Agilex® 7 FPGA - 生成用於模擬的EMIF設計實例
- Intel Stratix 10 生成用於模擬的 EMIF 設計實例
- Intel Arria 10 生成用於模擬的 EMIF 設計實例
- Intel Cyclone 10 生成用於模擬的 EMIF 設計實例
有關如何驗證EMIF設計的資訊,請參閱「驗證記憶體介面IP」課程的「培訓課程和視頻」部分。
在哪裡可以找到有關FPGA資源和引腳放置的資訊?
有關詳細的外部記憶體介面 (EMIF) 引腳資訊,請參閱以下 EMIF 智慧財產權 (IP) 使用者指南中的以下協定特定部分:
如需簡化的 I/O 放置,請參閱 Interface Planner,瞭解適用于 Intel Arria 10 和 Intel Stratix 10 FPGAs的 Intel Quartus Prime Pro Edition 軟體中提供的便於使用的拖放工具。有關如何使用 Interface Planner 及其優點的資訊,請參閱以下影片:
如需有關 Interface Planner 的資源位置分配的詳細資訊,請參閱以下線上培訓課程:
其他資源
什麼是乒乓球物理?
- Ping Pong PHY 允許兩個記憶體介面共用位址和命令匯流排。DDR3 和 DDR4 協定以及 Stratix® V、Intel Arria 10 和 Intel Stratix 10 FPGAs都支援此功能。有關乒乓PHY概念,其優點以及模擬結果分析的資訊,請參閱以下視頻:
在哪裡可以找到有關 PHYLite 的資訊?
- PHYLite IP 允許您構建適用于 Intel Arria 10 和 Intel Stratix 10 FPGAs的自訂記憶體介面 PHY 區塊。有關 PHYLite IP 的詳細資訊,請參閱以下使用者指南:
- 有關如何根據不同的 DQ/DQS 組大小正確為 PHYLite 分配引腳排列的詳細資訊,請參閱以下視頻:
- PHYLite 群組針腳放置影片 (注意:影片也適用于 Intel Stratix 10 台裝置。)
- PHYLite IP 支援 Intel Arria 10 和 Intel Stratix 10 FPGAs輸入和輸出緩衝器上的多種不同 I/O 標準和終端值。有關如何建立晶載終端 (OCT) 區塊以及如何將其與 PHYLite IP 中終止的 I/O 緩衝器相關聯的資訊,請參閱以下影片:
4. 電路板設計與模擬
在哪裡可以找到主機板佈局和設計的資訊?
如需詳細的外部記憶體介面 (EMIF) 板佈局和設計資訊,請參閱以下 EMIF 智慧財產權 (IP) 使用者指南中的以下協定特定部分:
如何執行電路板/通道模擬?
如需測量讀寫碼間干擾 (ISI) 和串擾、安排命令、定址、控制和資料引腳以及 I/O 組放置限制的資訊,請參閱以下準則:
如何計算電路板偏移和通道損耗?
有兩種工具可説明您計算電路板偏斜和通道損耗:
主題 |
電路板偏斜參數工具 |
通道損耗計算工具 |
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特徵 |
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支援 |
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工具 |
在哪裡可以找到有關時序收斂的資訊?
有關外部記憶體介面 (EMIF) 時序收斂的資訊,請參閱 EMIF 智慧財產權 (IP) 使用者指南中的以下部分:
5. 調試
如何調試外部記憶體介面設計?
有關調試外部儲存體介面 (EMIF) 智慧財產 (IP) 的資訊,請參閱《EMIF IP 使用者指南》中的以下部分:
如何使用 EMIF 調試工具組?
有關如何菊輪鍊式多個記憶體介面以與EMIF調試工具組相容的逐步說明,請參閱以下使用者指南:
EMIF調試工具組中的讀/寫二維眼圖功能可為每個資料引腳生成讀寫眼圖。有關 EMIF IP 生成過程中重要基準電壓源參數以及如何使用 2-D 眼圖功能的資訊,請參閱以下視頻:
流量產生器 2.0 允許您通過可自訂的流量和測試模式測試和調試外部記憶體介面。有關如何使用流量產生器 2.0 功能的詳細資訊,請參閱以下指南和視頻:
- 流量產生器 2.0 指南
- 流量產生器 2.0 視頻(即將推出)
驅動程式裕量功能可讓您在使用者模式流量期間捕獲每個針腳的讀寫邊距資料。如需磁碟機裕量調節與校準余量調節之間的差異資訊,以及如何使用磁碟機余量調節功能的說明,請參閱下列影片:
有關如何調試EMIF設計的資訊,請參閱以下線上培訓課程:
訓練課程 |
描述 |
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本課程介紹如何使用 EMIF 工具組或片上調試工具組執行調試,如何使用流量產生器 2.0,以及配置多個記憶體介面設計以與這些調試工具相容。 |
在哪裡可以找到有關優化控制器性能的資訊?
有關控制器性能和效率的資訊,請參閱外部記憶體介面 (EMIF) 智慧財產 (IP) 使用者指南中的以下部分:
如何瞭解 EMIF 的已知問題?
有關EMIF IP的當前和已知問題的資訊,請參閱知識庫:
6. 培訓課程和快速視頻
訓練課程
Intel Agilex 7裝置
- Intel Agilex® 7 FPGAs F 和 I 系列中的記憶體介面簡介
- Intel Agilex® 7 FPGAs F- & I 系列記憶體介面的整合
- 驗證 Intel Agilex® 7 FPGAs F 和 I 系列中的記憶體介面
- Intel Agilex® 7 FPGAs F 和 I 系列記憶體介面的片上調試
Intel Arria 10 和 Intel Stratix 10 台設備
快速視頻
- DDR4 Ping-Pong Phy(支援的裝置為 Stratix V、Intel Arria 10 和 Intel Stratix 10)
- 介紹外部記憶體介面設計的藍圖平臺設計器,第 1 部分(共 2 部分)
- 介紹用於外部記憶體介面設計的藍圖平臺設計器,第 2 部分(共 2 部分)
- Intel FPGA外部記憶體介面封裝糾偏
- Intel Arria 10 EMIF IP 的電路板時序
- 在 Intel Arria 10 外部記憶體介面中實現過度約束
- 自動檢查Intel® FPGA外部記憶體介面主機板佈局指南
- 如何為 Intel Arria 10 開發工具組構建 EMIF 設計RLDRAM3並使用 EMIF 工具組測試校準狀態
- Intel Arria 10 外部記憶體介面工具組
- Intel Arria 10 EMIF示例流量產生器
- 使用軟Nios®處理器調試Intel Arria 10 個外部記憶體介面
其他推薦使用者指南
有關外部記憶體介面 (EMIF) 智慧財產 (IP) 的資訊,請參閱以下 EMIF IP 使用者指南:
外部記憶體介面的其他培訓課程
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