當 eSRAM Intel® Stratix®設計中包含 10 FPGA IP 時,您可能會在某些通道中看到錯誤的資料或所有「零」資料。
若要解決此問題,請包括「重設發行Intel® FPGA IP」,並將「重設版本 Intel FPGA IP的nINIT_DONE 輸出訊號連接至 eSRAM® Intel Stratix 10 FPGA IP 的輸入訊號 c _sd_n_0。
此資訊包含在 Intel Stratix 10 嵌入式記憶體使用指南中。
當 eSRAM Intel® Stratix®設計中包含 10 FPGA IP 時,您可能會在某些通道中看到錯誤的資料或所有「零」資料。
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