由於 Quartus® II 軟體 12.1 SP1 和更早版本的問題,在執行 SignalTap™ II 邏輯分析器時,您可能會看到這個錯誤。由於 JTAG TDO 路徑優化不正確,因此會出現此問題。此問題影響到以 V Stratix®、Arria® V 和 Cyclone® V 裝置為目標的設計。
為了避免此問題,請適當限制 JTAG TDO 路徑並重新相容您的設計。若要正確限制 JTAG TDO 路徑,請將下列限制新增到您的 Synopsys Design Constraints (.sdc) 檔案中。
if { [string equal quartus_fit $::TimeQuestInfo(nameofexecutable)] }
{ set_max_delay -to [get_ports { altera_reserved_tdo } ] 0 }
這個問題已經解決,從 Quartus II 軟體版本 13.0 開始,路徑受到適當限制。