文章 ID: 000076304 內容類型: 疑難排解 最近查看日期: 2013 年 02 月 11 日

LPDDR2 硬記憶體控制器在 300MHz 和 333MHz Cyclone V 裝置上的硬體故障

環境

  • Intel® Quartus® II 訂閱版
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    重大問題

    描述

    此問題影響到 LPDDR2 產品。

    以 300 MHz 或 333 MHz Cyclone V 裝置為目標的 LPDDR2 設計 由於硬記憶體控制器位設定,硬體將會故障 SRAM 物件檔案 (.sof) 中不匹配。

    解決方法

    此問題的解決方法是執行 LPDDR2 設計與 200 MHz 或 267 MHz 的 Cyclone V 裝置上的硬記憶體控制器 而不是在 300 MHz 或 333 MHz。如果您使用的是 LPDDR2-S4 記憶體裝置,將 tCCD 值從 1 變更為 2。

    此問題已在版本 12.1 SP1 DP1 中修正。

    相關產品

    本文章適用於 1 產品

    Cyclone® V FPGA 與 SoC FPGA

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