重大問題
如果ls_clk[2:0] 是從 3 個獨立的頻率源計時,而不是單一頻率源,HDMI RX core IP 可能會遇到計時違規。這是由於在 HDMI RX 核心 IP 中,將個別 TMDS 資料路徑交叉至ls_clk[0] 頻率域的頻率領域時,處理不當所造成的。
在連接 HDMI RX 核心 IP 之前,將所有 3 ls_clk[2:0] 從相同的頻率來源,並執行資料同步到該單一頻率源。
使用者也可以參閱 Arria® 10 HDMI 設計範例mr_hdmi_rx_core_top.v 設計檔案以示範連線。範例設計可由 HDMI 核心 IP 產生。
此問題已在 Quartus® Prime 版本 17.0 更新 1 中修復。