重大問題
如果您嘗試模擬,請使用 Mentor Graphics ModelSim-Altera 軟體,包含低延遲 PHY 超級功能的 VHDL 設計 使用 10 Gbps 資料路徑,模擬失敗時發生類似錯誤 下列內容:
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# Time: 0 ps Iteration: 0 Instance: /test_tst/test_inst/test_inst/// File:
nofile
# FATAL ERROR while loading design
# Error loading design