由於 Prime 軟體Intel® Quartus®問題,您可能會發現,對於Intel® Arria® 10 個 SX 裝置,ALTCLKCTRL Intel® FPGA IP分配到 CLKCTRL_2L_G_I17 位置時,輸出頻率訊號會被卡在高處。
若要解決此問題,請建立 ALTCLKCTRL Intel® FPGA IP實例,並在 Quartus 設定檔 (.qsf) 中新增下列作業,以保留 d controller 實例並修復位置以 CLKCTRL_2L_G_I17。
set_location_assignment CLKCTRL_2L_G_I17──對
set_instance_assignment──PRESERVE_FANOUT_FREE_WYSIWYG ON-to